SH-Navi3 embeds ■ High performance dual RISC processors (1920 MIPS) ■ 2D/3D graphic accelerators ■ Image recognition engine — High-speed processing (up to 53.3GOPS): parallel processing + pipeline architecture + function specific accelerator — Bus traffic reduction & Line programmability: PIPE architecture


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    Titel :

    SoC for car navigation systems with a 53.3 GOPS image recognition engine


    Beteiligte:


    Erscheinungsdatum :

    2009-08-01


    Format / Umfang :

    13901552 byte




    Medientyp :

    Aufsatz (Konferenz)


    Format :

    Elektronische Ressource


    Sprache :

    Englisch



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