This paper describes a dual-processor platform for automotive power-train control with a high-bandwidth interconnection network among processors, memory, and I/0 sub-systems, which is suitable for a System-On-Chip (SOC) implementation. The two processors share memory and I/0 address space and can operate in parallel at full speed. The cost of this solution, in terms of gates and power dissipation, is not substantially higher than more classical architectures with a multi-master bus or multiple processor busses connected through gateways, but offers almost twice the performance.


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    Titel :

    Design and implementation of a dual processor platform for power-train systems


    Weitere Titelangaben:

    Entwurf und Implementierung einer Zwei-Prozessor-Plattform für die Leistungsregelung


    Beteiligte:
    Ferrari, A. (Autor:in) / Garue, S. (Autor:in) / Peri, M. (Autor:in) / Pezzini, S. (Autor:in) / Valsecchi, L. (Autor:in) / Andretta, F. (Autor:in) / Nesci, W. (Autor:in)


    Erscheinungsdatum :

    2000


    Format / Umfang :

    7 Seiten, 4 Bilder, 7 Quellen




    Medientyp :

    Aufsatz (Konferenz)


    Format :

    Print


    Sprache :

    Englisch




    Design and implementation of a dual processor platform for powert-train systems

    Ferrari,A. / Garue,S. / Peri,M. et al. | Kraftfahrwesen | 2000


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